第595章 召集一下同志,我有好东西！

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而djs-59这个数字就庞大了，没有硬件乘法器的它，只能通过程序指令，一步一步的控制加法器和寄存器完成乘法运算。

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对于djs-59来说，大概15个指令才能完成一次8二进制位的整数乘法运算，其中又有不少多周期指令，综合下来，大约是25个指令周期才能完成一次乘法运算。

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而且这只是8位的情况，如果扩展到16位、32位，那这个数字还会上升。

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至于浮点数，那这个情况就更加恶劣了。

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这就是djs-59的弱点，也是早期大部分通用cpu的弱点，高级一点的数学运算它是不行的。

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但是对于信号处理来说，乘法算是基本运算，也是使用最多的运算。

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这就是通用cpu用到信号处理上非常羸弱的原因，算不过来，娘胎里的毛病。

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但是高振东的下一步，一切的一切，最终目标都基本上直指雷达，靠djs-60d，哪怕是ic化了，也一样是个弱鸡，不够好。

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所以高振东就琢磨着自己做一个硬件乘法器，而且目标直指单周期浮点硬件乘法器，赞美互联网，赞美导师，前世这东西，他是在vhdl上面实现过的，对于其结构，清楚得很。

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vhdl，硬件描述语言，在cpld/fpga上的ic设计语言之一，能够直接设计ic硬件结构。

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虽然vhdl的最终结果是基于逻辑单元的，和用晶体管或者逻辑门直接搭的连接有区别，可是其依据的算法，高振东却是门儿清，还是能换得过来的。

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之所以这个乘法器的电路板这么大个，这就是原因，要只是一个加法器实现的硬件乘法器，那就在djs-60d里面增加就好了，成本面积增加都不多，但是相应的，性能增加也就不多，这个事情要做，但

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